2026 年 8 月 23 日，在加州斯坦福大学举行的 Hot Chips 2026 大会" Day 0 "教程中，好意思光科技（Micron Technology）HBM 遐想架构筹商员 Raghu Sreeramaneni 提倡中枢不雅点：在不升内存代际的情况下，单纯普及浮点运算能法处置 AI 芯片算力与内存供给之间的差距。该差距每两年扩大相配于稀疏 50 的量，这演示将业界对于"内存墙"的迁延讨论升沉为具体的算术问题。
本周，Hot Chips 2026 正在斯坦福大学举行，好意思光、三星和 SK 海力士均展示了用带宽内存（HBM 要道）。这种行业汇注标明，对于 2026 年及以后构建或采购加快器的各而言，内存死心已成为 AI 硬件遐想的中枢议题。
算力增速远内存，差距捏续复利扩大
Sreeramaneni 指出，AI 加快器的 TFLOPS（每秒万亿次浮点运算次数）约每两年增长三倍，而 HBM 带宽同时增长不及两倍。跟着硬件代际迭，若系统 TFLOPS 是前代的 3 倍，但内存带宽仅为 2 倍，执行 AI 迷糊量只可达到 2 倍，且庸碌低。由于大大齐大型话语模子理职责负载受限于内存带宽而非计较智商，计较单位常处于恭候数据的恬逸景况。每过两年，这种恬逸过程会稍稍恶化。
"内存墙"术语由 Wulf 和 McKee 于 1995 年次提倡。好意思光这次量化了 AI 语境下内存墙的飞腾速率，并说明即使沟通到 HBM 发展至 2038 年的好意思满轨迹，这瓶颈也法舍弃。
HBM 架构领略：硅本钱为何是 DDR5 的三倍
HBM 并非 DDR5 的浅近提速版。步骤 DDR5 模块将扁平 DRAM 芯片焊合至电路板；而 HBM 秉承多颗 DRAM 芯片（庸碌 8 至 12 颗），减薄后垂直堆叠，并通过数千个硅通孔（TSV）相接，终通过封装固定在硅中介层上，与计较芯片并列装置。封装完成后，内存与计较成为全体，现场法单升。
HBM 的带宽势源于其宽接口：DDR5 使用 64 位通谈，HBM3E 使用 1,024 位接口，HBM4 则翻倍至 2,048 位。总线越宽，并行挪动数据越多，但代价昂。遐想复杂、TSV 酿成和封装致 HBM3E 提供不异存储容量时，铺张的制造硅面积约为 DDR5 的三倍。
数据显现，个典型的当代 AI 加快器封装包含个基础芯片和八个使用十二层堆叠的 HBM4 实例，总名义积过 12,000 平毫米。其中内存硅面积过 GPU 芯片本人名义积的八倍。在当代 AI 加快器封装中，内存而非 GPU 才是主组件。
从 HBM3E 到 HBM4：制造挑战与经济账
HBM3E 每个 DRAM 芯片领有 128 个存储库，通过 1,024 个 IO 相接通讯；HBM4 将这两项目的均翻倍。跟着 IO 数目翻倍，中介层布线密度需成比例增多，TSV 酿成工艺尖刻，良率压力随之增多。HBM 与 DDR5 之间三比的硅本钱比例反馈了这制造现实。
好意思光 2026 年全年 HBM 供应已在岁首前订立约贺州预应力钢绞线价格，HBM4 于 2026 岁首启动为英伟达 Vera Rubin 平台供货。好意思光预测，行家 HBM 总可寻址市集将从 2025 年的约 350 亿好意思元增长至 2028 年的约 1000 亿好意思元，年复增长率约为 40。
可靠挑战：纠错与热机械应力
当代 AI 老师对内存造作实在容忍。HBM 秉承双层纠错架构：系统别每次访谒捎带 16 位元数据纠错数据；DRAM 堆栈里面运行基于象征的里德 - 所罗门（Reed-Solomon）纠错码，以处理密度下的造作形态。
热学可靠面，异构集成封装中各组件热推广统共不匹配，随温度变化产生热机械应力，可能致分层或开裂。好意思光指出，跟着堆叠增，这问题日益进攻。缓解措施包括液冷、混键以及改动焊料因素和模塑材料。
封装技艺：共封装光学与玻璃基板
当带宽需求过增多 HBM 实例所能处置的限度时，封装技艺成为环节。共封装光学（CPO）将光收发器平直集成到加快器封装中，钢绞线厂家舍弃序列化要领，责难多机架 AI 集群中节点间挪动数据的蔓延和功耗。CPO 通过将光相接腹地化到封装里面，处置节点间带宽贬抑。
玻璃基板代表中介层的结构鼎新。比较有机基板，玻璃提供考究公役、低信号损耗，并能容纳大中介层，以符合捏续增长 HBM 堆叠数目。台积电 CoWoS-L 和 CoWoS-R 时局代表了迈向大尺寸片上硅的中间要领。
HBM8 途径图：差距仍未放松
把柄韩国科学技艺院（KAIST）等机构筹商，HBM5 预测 2029 年傍边投产，带宽每秒 4TB；HBM6 在 2032 年傍边达到每秒 8TB；HBM7 在 2035 年傍边达到每秒 24TB；HBM8 在 2038 年傍边达到每秒 64TB。尽管对值浩大，但按每两年三倍计较扩展率评估，计较增益仍过带宽增益。内存墙并未关闭，而是随每个硬件周期进取漂移。
对于大型话语模子理职责负载，关系目的是系统所捎带 HBM 代际的带宽规格。配备较旧 HBM 代际的 TFLOPS 芯片，在理迷糊量上频频输给配备较新 HBM 代际的低 TFLOPS 芯片，因为理受限于内存。
演讲影响：再行界说 AI 硬件评估步骤
Hot Chips 是架构师浮现决定昔日 12 至 24 个月采购有筹划的技艺与贬抑之地。好意思光展示的量化互异是项遐想贬抑浮现，将指大畛域企业、云行状提供商和企业 AI 买在 2027 年和 2028 年指定系统的式。
未经相应内存带宽数据和 HBM 代际相通符发布的原始 TFLOPS 目的，算作 AI 基础设施评估步骤已变得不好意思满。通过移至新计较芯片并将 TFLOPS 翻倍，若保留不异 HBM 代际，可能在受内存死心负载上带来实在稀疏理迷糊量；而移至较新 HBM 代际并保捏计较不变，将带来可测量迷糊量阅兵。
HBM 带宽、硅本钱、热能和可靠之间的量度，将塑造接下来几代加快器的遐想、轨范和采购式。好意思光在 Hot Chips 2026 上的演示从根柢上承认，内存已取代计较成为 AI 硬件的中枢遐想问题，而紧随 HBM 堆叠之后的封装技艺，将是得回 AI 能下阶段斗争的环节。
常见问题解答
HBM 带宽何时能赶上 AI 计较迷糊量？
基于好意思光 Hot Chips 2026 数据及 KAIST/Tera HBM 途径图，谜底是讨论的。至少通过筹划到 2038 年 HBM8 的轨迹，AI 加快器 TFLOPS 每两年增长三倍，而 HBM 带宽增长不及两倍。即使 HBM5 至 HBM8 提供浩大带宽增益，这些增益在每个要领上齐过期于计较扩展率。差距不会放松，而是复利增长。
计较 - 内存差距对评估 AI 硬件有何真理？
对于受内存死心的理职责负载，系统所捎带的 HBM 代际比 TFLOPS 计数是有真理的能预测目的。具有 TFLOPS 但较旧 HBM 代际的芯片，庸碌比具有较低 TFLOPS 和较新 HBM 代际的芯片提供较低理迷糊量。评估 AI 硬件时，应究诘每堆叠带宽数据和 HBM 代际，并对内存目的赋予权重。
HBM 架构怎样物理上提供带宽？
HBM 用宽接口替换传统 DDR5 窄 64 位通谈—— HBM3E 为 1,024 位，HBM4 为 2,048 位。为结束此宽度并保捏内存围聚计较芯片，HBM 垂直堆叠多个 DRAM 芯片，并通过硅通孔（TSV）相接。通盘组件平直坐在 GPU 驾驭硅中介层上，裁汰信号旅途。量度在于制造复杂和本钱：吉字节 HBM3E 铺张制造硅面积约是吉字节 DDR5 的三倍。
什么是共封装光学，为何好意思光在内存演讲中包含它们？
共封装光学（CPO）将光收发器平直集成到芯片封装中。好意思光包含它们是因为大型 AI 集群带宽问题不仅波及单节点内数据挪动，还波及数千节点间数据挪动。当 AI 系统畛域出单台行状器容纳智商时，节点间带宽成为二堵内存墙。CPO 通过将光相接拉近至接近计较芯片位置，减少电信号退换为光信号时的蔓延和功耗，从而处置这二堵墙。
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